Contribution à l'étude des effets de la réduction des dimensions du transistor MOS PDF Download
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Author: Jean-Georges Kiefer
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Author: Jean-Georges Kiefer
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Author: Jean-Georges Kiefer
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Pages : 148
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CE MEMOIRE TRAITE DES EFFETS DE PETITES DIMENSIONS DU TRANSISTOR METAL-OXYDE-SEMICONDUCTEUR (MOS). LES PRINCIPALES METHODES DE MAIGRISSEMENT SONT ANALYSEES ET LES GRANDES LIGNES DE L'EVOLUTION DES TECHNOLOGIES MOS SONT ESQUISSEES. UN MODELE COURANT-TENSION DU TRANSISTOR, QUI PREND EN COMPTE CES EFFETS PHYSIQUES ET QUI SE PRETE BIEN A UNE EXTRACTION DE PARAMETRES RAPIDE ET FACILE, EST ADOPTE. CETTE DERNIERE ETUDE EST CONCRETISEE PAR LA MISE AU POINT ET LA PROGRAMMATION D'UN BANC DE CARACTERISATION EN CONTINU. UNE STRUCTURE D'AMPLIFICATEUR OPERATIONNEL EST ETUDIEE ET REALISEE DANS UNE TECHNOLOGIE CMOS REDUITE. ENFIN, LES CONSEQUENCES DES PETITES DIMENSIONS SUR LES PERFORMANCES DE CET AMPLIFICATEUR OPERATIONNEL SONT EVALUEES.
Author: Gérard Merckel
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Pages : 171
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LES DIFFERENTS CHAPITRES DE CETTE ETUDE ONT PORTE SUR LES PROPRIETES DE LA STRUCTURE MOS EN REGIME STATIQUE, LE COMPORTEMENT DU TRANSISTOR EN REGIME DE FAIBLE INVERSION, EN REGIME DE FORTE INVERSION ET EN REGIME NON SATURE, EN REGIME DE FORTE INVERSION ET EN REGIME SATURE, LES EFFETS PARASITES LIES A LA REDUCTION DES DIMENSIONS GEOMETRIQUES DU TRANSISTOR. L'ACQUISITION DES PARAMETRES DES MODELES UTILISES POUR CETTE ETUDE ET LEUR VALIDATION, ONT ETE EFFECTUEES A L'AIDE D'UN SYSTEME D'IDENTIFICATION AUTOMATIQUE, MIS AU POINT AU LABORATOIRE. TOUS LES MODELES ETUDIES ONT PERMIS DE DEFINIR DES MODELES SIMPLIFIES POUR LA CONCEPTION DE CIRCUITS ASSISTES PAR ORDINATEUR
Author: Abderrahmane Merrachi
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Languages : fr
Pages : 166
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L'EFFET DE LA MULTIPLICATION DES PORTEURS PAR AVALANCHE, CONSECUTIF A L'AUGMENTATION DU CHAMP ELECTRIQUE LATERAL AVEC LA TENSION DE DRAIN, REPRESENTE UNE DES LIMITATIONS MAJEURES RENCONTREES EN TECHNOLOGIE CMOS. CETTE THESE PROPOSE UNE CONTRIBUTION A LA COMPREHENSION DE CE PHENOMENE, ET A SA MODELISATION DANS LES TRANSISTORS MOS DE PETITES DIMENSIONS. DANS UN PREMIER TEMPS, LA STRUCTURE ET LES PROPRIETES DE LA TECHNOLOGIE CMOS, SUPPORT EXPERIMENTAL DE NOTRE ETUDE, SONT DECRITES; PUIS LES EFFETS ACTIFS ET PARASITES PREPONDERANTS, RELATIFS AUX TRANSISTORS, ET CONSECUTIFS A LA REDUCTION DES DIMENSIONS, SONT ANALYSES. CONCERNANT LE PHENOMENE D'AVALANCHE, LE COMPORTEMENT PHYSIQUE DU DISPOSITIF ILLUSTRE ET ETUDIE SUR LA BASE DE SIMULATIONS BIDIMENSIONNELLES PRESENTE DEUX PHASES: REDUCTION DE LA TENSION DE SEUIL, PUIS ACTIVATION DU TRANSISTOR BIPOLAIRE LATERAL PARASITE AUX FORTES INJECTIONS. CES DEUX EFFETS, MODELISES DE FACON APPROXIMATIVE ET SOUVENT CONTRADICTOIRE DANS LES PUBLICATIONS ANTERIEURES SUR LE SUJET, SONT CONDITIONNES, POUR L'ESSENTIEL, PAR: L'EXISTENCE D'UN CHAMP ELECTRIQUE DANS LE SUBSTRAT, LA RESISTANCE SUBSTRAT VARIABLE, LA GEOMETRIE VARIABLE (DE LA BASE) ET LE MODE DE POLARISATION PARTICULIER DU TRANSISTOR BIPOLAIRE LATERAL. LES EFFETS SONT PRIS EN COMPTE PAR UN MODELE ANALYTIQUE SIMPLE ET ORIGINAL, EN BON ACCORD TANT AVEC LES MESURES QU'AVEC LES SIMULATIONS NUMERIQUES; LES PARAMETRES CORRESPONDANTS SONT EXPLICITEMENT FONCTION DES DIMENSIONS DU TRANSISTOR, DONC DES REGLES DE DESSIN. LE TRAVAIL DE VALIDATION DU MODELE A ETE EFFECTUE SUR DES TRANSISTORS A CANAL N ET CANAL P, CONVENTIONNELS ET DE TYPE LDD, ISSUS DE DIVERSES FILIERES CMOS; LA CONCORDANCE ENTRE LES RESULTATS THEORIQUES ET EXPERIMENTAUX EST EXCELLENTE POUR UNE LARGE GAMME DE LONGUEURS DE CANAL ET DE TENSIONS APPLIQUEES. ENFIN, LA DEGRADATION DE LA RESISTANCE DYNAMIQUE DE SORTIE DU TRANSISTOR A CANAL N PRINCIPALE CONSEQUENCE D
Author: Paul-Henri Bricout
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Pages : 198
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Les progres les plus recents en matiere d'integration de composants mos ont permis d'atteindre le cap de 0.1 micron de longueur de canal, notamment grace a l'evolution de la lithographie haute resolution. Le comportement des transistors mos est alors fortement influence par le profil de champ electrique, a l'origine des effets de transport balistique et des effets canaux courts. A ce titre, l'optimisation de tels composants requiert une comprehension detaillee de la physique du transport electronique faisant appel a des outils de simulation performants. La premiere partie de cette these porte sur l'elaboration d'un simulateur de dispositifs nmos par la methode de monte carlo. Cette technique a ete completee par la mise au point d'un couplage avec la resolution d'equations etendues de derive-diffusion. Cette approche permet une convergence rapide des simulations et la prise en compte de phenomenes intervenant a des echelles de temps differentes. La methode de couplage a ete appliquee a la simulation de dispositifs fortement submicroniques, montrant que le phenomene de survitesse peut etre mis a profit pour ameliorer certaines caracteristiques electriques, notamment augmenter la transconductance. La reduction conjointe des dimensions des transistors et de leur tension d'alimentation a permis de mettre en evidence une reduction significative de l'energie maximale atteinte par les electrons qui attenue les phenomenes de degradation lies a l'injection dans l'oxyde de grille. Enfin, une architecture originale de transistor mos a grille enterree a egalement ete etudiee. Comparativement aux dispositifs plans conventionnels, ce type de structure presente un excellent controle des effets canaux courts. D'autre part, il a ete demontre que de bonnes performances en courant peuvent etre preservees grace a un niveau de dopage du substrat largement inferieur a celui d'un transistor plan.
Author: Jean-Baptiste Henry
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La réduction des dimensions des transistors à effet de champ MOS a depuis quelques années ralenti à cause de l'émergence de facteurs parasites tels que la résistance d'accès. En effet, la miniaturisation du canal s'est accompagnée par une diminution de sa résistance tandis que celle des zones d'accès à la frontière avec le canal est restée constante ou a augmenté. L'objectif de cette thèse a été de mettre en place une méthodologie de caractérisation électrique prenant en compte cette composante parasite longtemps considérée négligeable dans le milieu industriel.Dans un premier chapitre, le fonctionnement de la technologie CMOS et la spécificité de son adaptation FD-SOI sont d'abord présentées. La deuxième moitié du chapitre est quant à elle consacrée à l'état de l'art de la caractérisation électrique et de leur position vis-à-vis de la résistance d'accès.Le second chapitre présente une nouvelle méthode d'extraction des composantes parasites résistives et capacitives à l'aide de transistors de longueurs proches. Les résultats obtenus sont ensuite comparés aux modèles existants. De ces derniers, un nouveau modèle plus physiquement pertinent est proposé en fin de chapitre.Le troisième chapitre expose une nouvelle méthode de caractérisation électrique basée sur la fonction Y qui permet une analyse du comportement d'un transistor sur l'ensemble de son régime de fonctionnement. Cette nouvelle méthode est ensuite combinée à celle développée dans le chapitre 2 pour assembler un protocole expérimentale permettant de corriger et d'analyser l'impact des résistances d'accès sur les courbes de courant et les paramètres électriques.Finalement, le dernier chapitre applique la méthodologie vue dans la chapitre précédent à l'étude du désappariement stochastique des transistors. Les résultats obtenus sont ensuite comparés aux méthodes en vigueur dans les domaines industriel et académique qui présentent chacune leurs avantages et leurs inconvénients. La nouvelle méthode ainsi proposée tente de garder le meilleur de chacune de ces dernières.
Author: SAMIA.. MOUSSAOUI
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LA REDUCTION DES DIMENSIONS DES DISPOSITIFS ELEMENTAIRES FORMANT DES CIRCUITS INTEGRES A ETE RENDUE POSSIBLE PAR LE PROGRES DE LA TECHNOLOGIE, NOTAMMENT LA LITHOGRAPHIE ET LES TECHNIQUES DE GRAVURE SECHE. L'EVOLUTION DE LA TECHNOLOGIE VERS LES STRUCTURES MICROELECTRONIQUES ET SUBMICRONIQUES A FAIT EMERGER DE NOUVEAUX PROBLEMES LIES A LA FIABILITE DES COMPOSANTS. CERTAINS PARMI EUX QUI POUVAIENT ETRE NEGLIGES DANS L'ANALYSE DU FONCTIONNEMENT DES TRANSISTORS MOS DE GRANDES DIMENSIONS, DEVIENNENT TRES IMPORTANTS POUR LES TRANSISTORS SUBMICRONIQUES. NOTRE ETUDE CONSISTE A ETUDIER LE TRANSISTOR MOS ET LES PHENOMENES LIES A LA REDUCTION DE LA LONGUEUR DU CANAL. NOUS NOUS SOMMES PARTICULIEREMENT INTERESSES A DEUX EFFETS: L'EFFET DE MULTIPLICATION PAR AVALANCHE ET L'EFFET D'AUTOECHAUFFEMENT DU TRANSISTOR. NOUS AVONS PRESENTE UNE NOUVELLE APPROCHE SIMPLE ET RAPIDE QUI TIENT COMPTE DU PREMIER EFFET. NOUS AVONS PRESENTE UN DEUXIEME MODELE QUI TIENT COMPTE DE LA VARIATION DE LA TEMPERATURE DANS LE CANAL, CONSEQUENCE DE L'AUGMENTATION DE LA PUISSANCE DISSIPEE PAR EFFET JOULE DANS LE TRANSISTOR. NOUS AVONS REMARQUE QUE NOS APPROCHES NE PERMETTAIENT QU'UNE VUE GLOBALE DES EFFETS DE DEGRADATION DU TRANSISTOR MOS, AUSSI NOUS LES AVONS INTRODUIT DANS LE MODELE A CHARGES DISTRIBUEES (MCD). CE DERNIER SUBDIVISE LA ZONE ACTIVE DU CANAL EN PLUSIEURS CELLULES, CE QUI PERMET D'AVOIR ACCES A TOUS LES PARAMETRES DU MODELE LE LONG DU CANAL. NOUS AVONS CONTRIBUE A RENDRE CE MODELE SUBMICRONIQUE PAR UNE REEVALUATION DE LA LONGUEUR DU CANAL, ET NOUS Y AVONS INTRODUIT L'EFFET D'AVALANCHE ET L'EFFET THERMIQUE. LE MODELE MCD ETANT LOURD EN TEMPS DE CALCUL, NOUS AVONS INTRODUIT AUSSI NOTRE APPROCHE A UNE MODELE SIMPLIFIE: LE MODELE UNICELLULAIRE, FONDE SUR LES MEMES BASES QUE LE MCD ET CONSIDERANT LE CANAL COMME UNE SEULE CELLULE DONT LA LONGUEUR EFFECTIVE EST CALCULEE DE LA MEME MANIERE QUE DANS MCD. POUR APPREHENDER L'APPORT DE NOS DEUX MODELES, UNE VALIDATION EN DEUX ETAPES, A EU LIEU. LA PREMIERE CONSISTE EN UNE IMPLANTATION DE NOS MODELES DANS LE LOGICIEL UTMOST (SILVACO DATA SYSTEM). LA SECONDE EN UNE COMPARAISON AVEC LES MEMES PARAMETRES DE LA SIMULATION ET DES MESURES EFFECTUEES SUR LA TECHNOLOGIE SUBMICRONIQUE DU CNET GRENOBLE, LA CMOS1T, DONT LA LONGUEUR ELECTRIQUE MINIMALE EST DE 0.8 M. LA CONCORDANCE ENTRE LES RESULTATS THEORIQUES ET EXPERIMENTAUX EST BONNE POUR UNE LARGE GAMME DE LONGUEURS DE CANAL ET DE TENSIONS APPLIQUEES.
Author: ELOI.. BLAMPAIN
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Pages : 144
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SOUS L'IMPULSION DES INNOVATIONS TECHNOLOGIQUES RECENTES, LA REDUCTION DES DIMENSIONS DES COMPOSANTS ELECTRONIQUES A ENTRAINE UNE MODIFICATION IMPORTANTE DE LEUR COMPORTEMENT ELECTRIQUE ET UNE PLUS GRANDE SENSIBILITE AUX AGRESSIONS EXTERIEURES. IL EST DONC TOUJOURS D'ACTUALITE D'ANALYSER LES PROCESSUS ELECTRONIQUES IMPLIQUES DANS CES NOUVELLES STRUCTURES. DANS CE BUT, NOUS PRESENTONS DANS CE TRAVAIL UNE ETUDE REALISEE SUR DES TRANSISTORS NLDDMOSFETS ISSUS DE LA TECHNOLOGIE 1,2 M DE MATRA-MHS, ET S'ARTICULANT SUR DEUX GRANDS AXES PRINCIPAUX: * LE PREMIER FAIT APPEL A UNE ETUDE EXPERIMENTALE, BASEE D'UNE PART SUR L'EVOLUTION DES PARAMETRES DE CONDUCTION DU TRANSISTOR, ET D'AUTRE PART SUR LA MODIFICATION DES PARAMETRES CARACTERISTIQUES DE LA JONCTION DRAIN-SUBSTRAT DU TRANSISTOR. UNE ETUDE COMPLEMENTAIRE DE CAPACITES MOS EST EFFECTUEE EN VUE D'ACCEDER A D'AUTRES PARAMETRES TECHNOLOGIQUES. UNE METHODOLOGIE DE CARACTERISATION COHERENTE DU TRANSISTOR ET DE SES ELEMENTS A ETE DEVELOPPEE. LA DETERIORATION DES PROPRIETES DE LA JONCTION DRAIN-SUBSTRAT VERS LE DOMAINE SUBMICRONIQUE A ETE ANALYSEE ET RELIEE A LA REDUCTION DES DIMENSIONS. L'EFFET DE LA REDUCTION DES DIMENSIONS SUR LA TENSION DE SEUIL A ETE MIS EN EVIDENCE. * LE DEUXIEME EST UNE SIMULATION 2-D DE CES DISPOSITIFS, REALISEE SUR DEUX NIVEAUX: UNE SIMULATION DU PROCEDE DE FABRICATION A L'AIDE DU SIMULATEUR DE PROCESS (BIDIMENSIONNEL) ATHENA. ELLE S'APPUIE ESSENTIELLEMENT SUR L'AJUSTEMENT DES PROFILS DE DOPAGE FOURNIS PAR LE CONSTRUCTEUR, PAR LE CHOIX APPROPRIE DES PARAMETRES PROCESS (ENERGIE ET DOSE D'IMPLANTATION, CONDITION DE RECUIT, ETC.). UNE SIMULATION DU COMPORTEMENT ELECTRIQUE STATIQUE DE CES DISPOSITIFS A L'AIDE DU SIMULATEUR DE DEVICES SPISCES-2B, S'APPUYANT PRINCIPALEMENT SUR LE CHOIX DES MODELES PHYSIQUES TRADUISANT AU MIEUX LES PHENOMENES A PRENDRE EN COMPTE DANS CE TYPE DE DISPOSITIFS. NOS OUTILS DE SIMULATION SONT DISTRIBUES PAR SILVACO INTERNATIONAL. FINALEMENT, CE TRAVAIL MET AU POINT UNE METHODE DE CARACTERISATION COHERENTE DES EFFETS DUS AUSSI BIEN A LA REDUCTION DES DIMENSIONS, QU'A CEUX LIES A LA DEGRADATION DU COMPORTEMENT ELECTRIQUE DE CES DISPOSITIFS, SUITE A UNE IRRADIATION. IL MET EN PLACE UNE METHODOLOGIE DE SIMULATION QUI A PERMIS DE MONTRER LE ROLE DE LA DOUBLE IMPLANTATION DU CANAL (B ET AS) POUR L'AJUSTEMENT DE LA TENSION DE SEUIL, L'INFLUENCE DE L'EPAISSEUR DU SUBSTRAT AINSI QUE LES EFFETS DE REDUCTION TECHNOLOGIQUE DU CANAL SUR LES CARACTERISTIQUES ELECTRIQUES. CE TRAVAIL MONTRE QUE LES IRRADIATIONS IONISANTES ET LES EFFETS DE DEPLACEMENT PEUVENT ETRE CARACTERISES PAR L'ETUDE DE LA JONCTION DRAIN-SUBSTRAT. IL MONTRE EGALEMENT QUE LA DOSE INFLUENCE LES PROCESSUS DE CONDUCTION DANS CETTE JONCTION AU MEME TITRE QU'UNE POLARISATION SUR LA GRILLE
Author: Jean-Charles Honoré
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Pages : 185
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CE MEMOIRE EST CONSACRE A L'OPTIMISATION DE TRANSISTORS FORTEMENT SUBMICRONIQUES. APRES AVOIR EXPOSE LES EFFETS PHYSIQUES LIMITANT LA REDUCTION DES DIMENSIONS, L'ANALYSE DES DIFFERENTES ARCHITECTURES DE TRANSISTORS EN CONCURRENCE NOUS A PERMIS DE DEGAGER CELLES OFFRANT LE MEILLEUR COMPROMIS ENTRE LA SIMPLICITE DE REALISATION ET LES PERFORMANCES LES PLUS ELEVEES. LA CARACTERISATION DETAILLEE DES DIFFERENTES VARIANTES TECHNOLOGIQUES (CANAL, DRAIN, OXYDE DE GRILLE) DES TRANSISTORS CMOS 0,25 M REALISES DANS LE CADRE DE CETTE ETUDE A PERMIS DE DEFINIR DES POINTS DE FONCTIONNEMENT POUR UNE FUTURE FILIERE CMOS 0,25 M. UNE METHODE D'OPTIMISATION DU CANAL, BASEE SUR DES SIMULATIONS NUMERIQUES A COURANT DE BLOCAGE CONSTANT FUT PROPOSEE ET APPLIQUEE DANS UN PREMIER TEMPS A DES NMOS 0,2 M AVEC ET SANS LDD ET DIFFERENTS PARAMETRES GEOMETRIQUES (PROFONDEUR DE JONCTION, EPAISSEUR D'OXYDE DE GRILLE). A L'AIDE DE CETTE METHODE, NOUS AVONS EGALEMENT ETUDIE L'IMPACT DES DIFFERENTS PROFILS DE DOPAGE DU CANAL SUR LES CARACTERISTIQUES ELECTRIQUES DES TRANSISTORS (PENTE EN FAIBLE INVERSION, NIVEAUX DE COURANT, CAPACITE DE JONCTION, ESTIMATEUR DE VITESSE DES CIRCUITS, ETC). PUIS DANS UN SECOND TEMPS L'OPTIMISATION A ETE APPLIQUEE A DEUX TYPES DE PROFIL DE DOPAGE DU CANAL D'UN NMOS 0,12 M AVEC EXTENSION DE DRAIN, L'UN IMPLANTE CONVENTIONNELLEMENT ET L'AUTRE EN CRENEAU (PSD). LA COMPARAISON DES DEUX OPTIMA OBTENUS A MONTRE LES AVANTAGES POTENTIELS DES PROFILS EN CRENEAU DANS LE DOMAINE FORTEMENT SUBMICRONIQUE. DE PLUS UNE OPTIMISATION DU DRAIN A PERMIS LA MISE EN EVIDENCE D'UNE TAILLE OPTIMALE D'ESPACEUR POUR UN NMOS 0,12 M AVEC EXTENSION DE DRAIN. ENFIN NOUS AVONS TERMINE PAR UNE ETUDE DE SENSIBILITE DE L'ANGLE D'IMPLANTATION DU DRAIN D'UN NMOS 0,2 M AVEC LATID, QUI NOUS A MONTRE LES AVANTAGES ET LIMITES DE CETTE ARCHITECTURE ET MIS EN EVIDENCE L'EXISTENCE D'UN ANGLE D'IMPLANTATION OPTIMAL DE L'ORDRE DE 45
Author: OULDELHADRAMI.. AHMED MISKE
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L'AMELIORATION DES TECHNOLOGIES DE FABRICATION DES CIRCUITS INTEGRES A ENTRAINE LA REDUCTION DES DIMENSIONS DU TRANSISTOR MOS (LONGUEUR DE CANAL DE 0.8 MICRON ET PROCHAINEMENT 0.5 MICRON). DE CE FAIT, DES PHENOMENES HIER NEGLIGEABLES DEVIENNENT PREPONDERANTS DANS LE FONCTIONNEMENT DU TRANSISTOR MOS. PARALLELEMENT LES CIRCUITS INTEGRES FONCTIONNENT DE PLUS EN PLUS RAPIDEMENT, LES TEMPS DE COMMUTATION DES SIGNAUX D'HORLOGES AVOISINENT LE TEMPS DE TRANSIT DES PORTEURS DANS LE CANAL, D'OU L'APPARITION, EN MODES LOGIQUE ET ANALOGIQUE, DE PHENOMENES LIES A L'INERTIE DES CHARGES DU CANAL DU TRANSISTOR MOS. L'APPROCHE CLASSIQUE DITE QUASI-STATIQUE (QUI CONSIDERE QUE LES CHARGES ASSOCIEES AUX DIFFERENTS NUDS DU TRANSISTOR MOS REPONDENT INSTANTANEMENT AUX SIGNAUX APPLIQUES), ACTUELLEMENT UTILISEE DANS TOUS LES MODELES IMPLANTES DANS LES SIMULATEURS DE CIRCUITS, N'EST PLUS VALABLE POUR LES HAUTES FREQUENCES. NOTRE ETUDE EST UNE CONTRIBUTION A LA RESOLUTION DE CES PROBLEMES. EN EFFET, APRES AVOIR ETUDIE LES PROBLEMES POSES PARTICULIEREMENT EN FONCTIONNEMENT DYNAMIQUE DU TRANSISTOR MOS, NOUS AVONS APPLIQUE LE MODELE A CHARGES DISTRIBUEES (MCD), QUI UTILISE LA RESOLUTION DE L'EQUATION DE LA CONSERVATION DE LA CHARGE EN DIFFERENTS POINTS DU CANAL DU TRANSISTOR MOS. LES SIMULATIONS EFFECTUEES EN STATIQUE A L'AIDE DE MCD IMPLANTE DANS ASTEC (CISI) CORRESPONDENT AUX MESURES EFFECTUEES SUR DES TRANSISTORS MOS SUBMICRONIQUES (LONGUEUR DE 0.4 MICRON, TECHNOLOGIE DU LETI). DE PLUS, EN FONCTIONNEMENT TRANSITOIRE MCD DONNE DES RESULTATS TRES PROCHES DE CEUX FOURNIS PAR LES MESURES ET LES MODELES NUMERIQUES COMPLEXES QUI SONT DIFFICILEMENT IMPLANTABLES DANS DES SIMULATEURS DE CIRCUITS COMME CEUX DE TURCHETTI, OH, DUTTON, CHAI... CETTE VALIDATION A DONC MONTRE QUE MCD EST UN MODELE SUBMICRONIQUE ET NON-QUASI-STATIQUE C'EST-A-DIRE QU'IL PREND EN COMPTE LE PHENOMENE D'INERTIE DES CHARGES. UNE FOIS LE MODELE MCD VALIDE, NOUS L'AV.
